Diseño e implementación de un sistema de recuperación de la temporización asíncrono totalmente digital
Este trabajo describe el diseño e implementación de una unidad de recuperación de la temporización completamente digital, para un sistema de comunicación que utiliza recepción paralela de datos, con modulación 4-PAM, filtrado Raised Cosine y una frecuencia nominal de muestreo de 1,1 GHz. Se explica...
| Main Authors: | , |
|---|---|
| Format: | Article |
| Language: | Spanish |
| Published: |
Instituto Tecnológico de Costa Rica
2015-06-01
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| Series: | Tecnología en Marcha |
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| Online Access: | https://revistas.tec.ac.cr/index.php/tec_marcha/article/view/2332 |
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| author | José Jaime Valenciano-Rojas Renato Rímolo-Donadio |
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| description | Este trabajo describe el diseño e implementación de una unidad de recuperación de la temporización completamente digital, para un sistema de comunicación que utiliza recepción paralela de datos, con modulación 4-PAM, filtrado Raised Cosine y una frecuencia nominal de muestreo de 1,1 GHz. Se explica el diseño de los diferentes bloques dentro del sistema, así como los resultados pertinentes a las simulaciones y la implementación física en FPGA.
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| format | Article |
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| institution | Directory Open Access Journal |
| issn | 0379-3982 2215-3241 |
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| publishDate | 2015-06-01 |
| publisher | Instituto Tecnológico de Costa Rica |
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| series | Tecnología en Marcha |
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